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PE43703
Product Specification
Performance Plots (continued)
Figure 21. Relative Phase Error
Figure 22. Relative Phase Error vs.
0dB
0.25dB
0.5dB
1dB
2dB
Temperature for 31.75 dB State
120
4dB
8dB
16dB
31.75dB
35.00
900 MHz
1800 MHz
3000 MHz
100
80
30.00
25.00
20.00
60
15.00
40
20
0
10.00
5.00
0.00
0
1
2
3 4 5
6
7
8
-40
-20
0
20
40
60
80
Frequency (GHz)
Figure 23. Attenuation Error @ 900 MHz
Temperature (Deg C)
Figure 24. Attenuation Error @ 1800 MHz
+25 C
-40C
+85C
+25C
-40C
+85C
1.5
1.0
0.5
0.0
-0.5
-1.0
-1.5
1.5
1.0
0.5
0.0
-0.5
-1.0
-1.5
0.0
4.0
8.0
12.0 16.0 20.0
24.0
28.0
32.0
0
4
8
12
16
20
24
28
32
Attenuation Setting (dB)
Figure 25. Attenuation Error @ 3000 MHz
Attenuation Setting (dB)
Figure 26. Input IP3 vs. Frequency
0dB
0.25dB
0.5dB
1dB
2dB
+25C
-40C
+85C
4dB
8dB
16dB
31.75dB
1.5
1.0
0.5
0.0
-0.5
70
65
60
55
50
45
40
-1.0
35
-1.5
0
4
8
12
16
20
24
28
32
30
0
1000
2000
3000
4000
5000
6000
7000
Attenuation Setting (dB)
Frequency (MHz)
?2008-2009 Peregrine Semiconductor Corp. All rights reserved.
Document No. 70-0245-05
│ UltraCMOS? RFIC Solutions
Page 6 of 15
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